【後藤弘茂のWeekly海外ニュース】 ZEN 2ベースの64コアCPU「Rome」はなぜCPUとI/Oを分離したのか

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記事へのコメント12件

●注目コメント ●新着コメント

Knoa いえーい、藤井聡太くん、見ってるぅー？ 2018/12/04 リンクその他 ● ● ●

kenchan3 ノースブリッジが復活してダイに載った感じだよね。 2018/12/04 リンクその他 ● ● ●

kotetsu306 なるほど納得。いっそI/Oをもっと粗いプロセスにしたら、安くなったり電圧高くできたりしないんだろうか 2018/12/04 リンクその他 ● ● ●

daishi_n MCMはいろいろ方法があるけど、シリコンインタポーザでやるのが高密度配線できるし、TSMCもインタポーザ技術持ってるからこれかな 2018/12/04 リンクその他 ● ● ●

chintaro3 I/Oは微細化の必要が無いので、CPUはちょっとでもチップサイズを小さくしたいってことか ●PC 2018/12/04 リンクその他 ● ● ●

moccos_info Athlonがメモリコントローラ統合してワクワクしたのも最早大昔… ●memory ●CPU 2018/12/10 リンクその他 ● ● ●

YaSuYuKi CPU同士及びIOダイの接続には、HBMの時のように、シリコンインターポーザを使うのだろうか http://eetimes.jp/ee/articles/1705/08/news021.html ●tech ●amd ●processor 2018/12/06 リンクその他 ● ● ●

John_Kawanishi pic.twitter.com/mF5o5AYpMl ●PC ●なるほど 2018/12/05 リンクその他 ● ● ●

gabill チャーハン大盛りは高いから、チャーハン＋白ご飯で我慢するよ...というお話。 2018/12/04 リンクその他 ● ● ●

chintaro3 I/Oは微細化の必要が無いので、CPUはちょっとでもチップサイズを小さくしたいってことか ●PC 2018/12/04 リンクその他 ● ● ●

Knoa いえーい、藤井聡太くん、見ってるぅー？ 2018/12/04 リンクその他 ● ● ●

kotetsu306 なるほど納得。いっそI/Oをもっと粗いプロセスにしたら、安くなったり電圧高くできたりしないんだろうか 2018/12/04 リンクその他 ● ● ●

daishi_n MCMはいろいろ方法があるけど、シリコンインタポーザでやるのが高密度配線できるし、TSMCもインタポーザ技術持ってるからこれかな 2018/12/04 リンクその他 ● ● ●

tanakh オッ(´・_・`) 2018/12/04 リンクその他 ● ● ●

kenchan3 ノースブリッジが復活してダイに載った感じだよね。 2018/12/04 リンクその他 ● ● ●

masterq "CPUダイを先端の7nmプロセスで製造する一方、I/Oダイは成熟した14nmプロセスで製造" まさか、、、CPUとI/Oをワイヤボンディングすることにはならないですよね。。。1つのウェハで結線もプリプロセスでやってほしいです。。 ●semiconductor ●cpu ●hardware 2018/12/04 リンクその他 ● ● ●

eibin Zen2 ●AMD ●CPU 2018/12/04 リンクその他 ● ● ● 注目コメント算出アルゴリズムの一部にLINEヤフー株式会社の﹁建設的コメント順位付けモデルAPI﹂を使用しています

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