clock signal使CLK[1][2](()使[3])

50%

デジタル回路

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 (IC) 使[4]: clock cycleIC1

使使

単相クロック

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単一のクロックのエッジにより、関係する全てのフリップフロップが動作する方式である。1990年代以降の大抵のクロック同期設計は単相である。

2相クロック

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マスタ-スレーブ方式のラッチ(フリップフロップ)を使う方式のクロックである。

4相クロック

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4相論理方式(en:Four-phase logic)などのクロックである。

事例

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 IMP-16使IMP-16490使

1970 MOS IC 2使MC680080802[5]ICIC6800808028224MC6875Intel 8085 680280802MHz1MHz6800808016800100kHz80801976[6]

6501 2 MOS 6502 22IC4使

クロック周波数と倍率

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1[7]Intel Core i7 3.20GHz3.20GHz (GHz) [7]1

CPUCPU: Base Clock; BCLK[8]CPUCPUCPU[9]2022x64 CPU100 MHz 3.20 GHzCPU100 MHzBCLKx32 CPU multiplier

動的周波数変更

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デジタル機器の多くは固定かつ一定の周波数のクロック信号を必ずしも必要としない。クロック周期の最大および最小時間の範囲内であれば、クロック周期ごとに時間(周期)が変動しても動作可能である。その場合、動的に周波数を変更できるクロックジェネレータを使うことができ、スペクトラム拡散クロックジェネレータ英語版 (SSCG)[10]PowerNow!Cool'n'QuietIntel SpeedStep テクノロジなどの動的周波数変更技術がある。

静的論理を用いたデバイスではクロック周期時間の上限(つまりはクロック周波数の下限)がなく、最終的にクロックを停止させるところまで低速にでき、そこから最高クロック速度にまで戻すこともできる。

その他の回路

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-使21使

CMOS使IC

 (OS) RTCCMOSRTCOSNTPOSRTCRTCRTCLinuxhwclock

分配

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使30%[11]H使使

脚註

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註釈

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出典

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(一)^ JISC0450 2004, A.5.

(二)^ JISX0003 1989, 03.01.10.

(三)^ bit bit 1990815196ISBN 4-320-02526-1 

(四)^ SiTime 2014.

(五)^ Motorola 1976.

(六)^ Microcomputer 1975.

(七)^ abKDDI 2014.

(八)^ " (BCLK) ... BCLK  CPU PCIe CPU " Intel. . 2022-04-08.

(九)^ "CPU  (BCLK)  CPU  (CPU ) " Intel. . 2022-04-08.

(十)^ FUJITSU 2003.

(11)^ Shimpi 2008.

関連項目

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クロック周波数

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関連用語

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参考文献

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 (PDF).  - SiTime. SiTime. p. 3 (20141). 202062

. . KDDI CORPORATION (201435). 202062

LSI. LSI - FUJITSU Japan.  (200342). 202062

Anand Lal Shimpi (200842). Gridless Clock Distribution (). Intel's Atom Architecture: The Journey Begins. AnandTech. 2020227

Motorola (1976-04-15). How to drive a microprocessor (). Electronics (McGraw-Hill) 49(8): 159. https://commons.wikimedia.org/wiki/File:Motorola_MC6870_ad_April_1976.jpg 2020227. 

Intel's Higher Speed 8080 μP (). Microcomputer Digest (Microcomputer Associates) 2(3): 7. (1975-09). https://commons.wikimedia.org/wiki/File:Motorola_MC6870_ad_April_1976.jpg 2020227. 



JIS X 0003:1989調

JIS C 0450:2004調